| 密碼SoC中嵌入式鏈式DMA的研究與設(shè)計 | |
| 所屬分類：參考設(shè)計 | |
| 上傳者：aet | |
| 文檔大小：472 K | |
| 標簽： 密碼片上系統(tǒng) 數(shù)據(jù)傳輸方式 嵌入式鏈式傳輸 | |
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| 文檔介紹：為了提高密碼SoC中密碼運算模塊與其他功能部件之間數(shù)據(jù)傳輸?shù)男剩岢隽艘环N適合密碼運算的嵌入式鏈式DMA傳輸方式。分析了CPU傳輸、Block DMA傳輸和鏈式DMA傳輸3種數(shù)據(jù)傳輸方式的特點；設(shè)計了嵌入式鏈式DMA的硬件架構(gòu)，給出了其工作流程；為嵌入式鏈式DMA設(shè)計了主從復(fù)合接口，使其具有控制總線、發(fā)起總線傳輸?shù)墓δ埽皇褂?5 nm CMOS工藝標準單元庫對嵌入式鏈式DMA模塊進行了ASIC實現(xiàn)；搭建了仿真驗證平臺。實驗結(jié)果表明，嵌入式鏈式DMA可以明顯提升密碼SoC數(shù)據(jù)傳輸效率，滿足了功能和性能的需求。 | |
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