| 基于EPIC技術的密碼處理器體系結構研究與設計 | |
| 所屬分類：技術論文 | |
| 上傳者：aet | |
| 文檔大?。?span>682 K | |
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| 文檔介紹：以分組密碼和摘要算法為研究對象，結合處理器體系結構的特點，研究了能夠高效靈活實現多種分組密碼和摘要算法的處理器體系結構。通過分析現有分組密碼算法的運算和結構特點，從實現方式的靈活性和高性能角度出發，提出了一種基于顯式并行指令計算結構且性能和靈活性達到了折衷的可編程密碼微處理器體系結構。給出了系統的整體架構、可重構運算單元的設計方案及其指令系統的設計，以及用硬件描述語言Verilog實現后的硬件測試參數。 | |
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