| 基于FPGA的高效靈活性數(shù)字正交下變頻器設(shè)計(jì) | |
| 所屬分類：參考設(shè)計(jì) | |
| 上傳者：aet | |
| 文檔大小：395 K | |
| 標(biāo)簽： FPGA | |
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| 文檔介紹：數(shù)字正交下變頻器DDC是數(shù)字接收機(jī)系統(tǒng)中的核心部件，其作用是將ADC數(shù)字化后輸出的高速中頻信號進(jìn)行下變頻、抽取降速和低通濾波，使之變?yōu)檫m合處理的基帶信號。給出了DDC各模塊在FPGA中高效實(shí)現(xiàn)的方法，并且利用嵌入式邏輯分析儀對系統(tǒng)加載板卡后的實(shí)時(shí)運(yùn)行結(jié)果進(jìn)行了測試分析。 | |
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