| 嵌入式實(shí)時(shí)控制系統(tǒng)硬件可靠性及應(yīng)用研究 | |
| 所屬分類：技術(shù)論文 | |
| 上傳者：aet | |
| 文檔大小：617 K | |
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| 文檔介紹： 嵌入式實(shí)時(shí)控制系統(tǒng)硬件故障是造成系統(tǒng)失效的主要原因之一，針對(duì)此問題，首先定義嵌入式實(shí)時(shí)控制系統(tǒng)硬件體系結(jié)構(gòu)；然后分析嵌入式實(shí)時(shí)控制系統(tǒng)的可用性和失效模式，并對(duì)單個(gè)IP硬核和嵌入式實(shí)時(shí)控制系統(tǒng)硬件應(yīng)用Markov鏈建立了可靠性模型；最后用所建立的模型，對(duì)嵌入式聯(lián)鎖控制器硬件進(jìn)行了可靠度計(jì)算和分析。通過計(jì)算可知，所建立的可靠性模型能夠描述嵌入式實(shí)時(shí)控制系統(tǒng)硬件的狀態(tài)變遷，并能定量預(yù)測(cè)和分析其可靠度，模型具有一定的實(shí)用價(jià)值。 | |
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