| JPEG2000 MQ編碼器的設(shè)計與實現(xiàn) | |
| 所屬分類：技術(shù)論文 | |
| 上傳者：aet | |
| 文檔大小：1352 K | |
| 標簽： SoPC | |
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| 文檔介紹：提出了一種JPEG2000 MQ編碼器的硬件設(shè)計方案。通過狀態(tài)更新超前預(yù)測、前導(dǎo)零檢測、重歸一化超前預(yù)測等方法以及字節(jié)輸出的改進處理，使MQ編碼器的工作速率可達1CxD/cycle。同時對各流水段中的路徑進行優(yōu)化改進，提高了系統(tǒng)的最高時鐘頻率。采用Verilog語言進行RTL級描述，并在Altera的FPGA上進行了仿真驗證。結(jié)果表明，在Altera的EP2S60F67214上，該MQ編碼器的最高工作時鐘頻率可達65.19 MHz。 | |
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