| 基于FPGA的寬帶數(shù)字接收機變帶寬數(shù)字下變頻器設計 | |
| 所屬分類：解決方案 | |
| 上傳者：chenyy | |
| 文檔大小：3897 K | |
| 標簽： SoPC | |
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| 文檔介紹：數(shù)字下變頻器（Digital Down-Converter，DDC）是寬帶數(shù)字接收機的重要組成部分，本文基于FPGA芯片Stratix II EP2S60F672C4設計了一個適用于寬帶數(shù)字接收機的帶寬可變的數(shù)字下變頻器（VB-DDC）。該VB-DDC結(jié)合了傳統(tǒng)數(shù)字下變頻結(jié)構(gòu)與多相濾波結(jié)構(gòu)的優(yōu)點，實現(xiàn)了對輸入中頻信號的高效高速處理，同時可以在較大范圍內(nèi)對信號處理帶寬進行靈活配置。硬件調(diào)試結(jié)果驗證了本設計的有效性。 | |
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