| 改進(jìn)的并行CORDIC算法研究及其FPGA實現(xiàn) | |
| 所屬分類：技術(shù)論文 | |
| 上傳者：aet | |
| 文檔大小：193 K | |
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| 文檔介紹：在介紹基本CORDIC算法原理的基礎(chǔ)上，介紹了其改進(jìn)的并行算法原理。對并行CORDIC算法進(jìn)行了詳細(xì)敘述，并且使用Verilog HDL描述了該算法。通過模塊復(fù)用，并且采用兩相門控時鐘等方法，節(jié)省了FPGA資源，保持了信號的同步性。最后在Quartus II下進(jìn)行了綜合、仿真，取得了良好的仿真結(jié)果。 | |
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