| 動(dòng)態(tài)相位調(diào)整技術(shù)在FPGA中的設(shè)計(jì)與實(shí)現(xiàn) | |
| 所屬分類：技術(shù)論文 | |
| 上傳者：aet | |
| 文檔大小：230 K | |
| 標(biāo)簽： FPGA | |
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| 文檔介紹：提出一種基于FPGA的動(dòng)態(tài)相位調(diào)整實(shí)現(xiàn)方案。在高速數(shù)據(jù)傳輸接口中，由于數(shù)據(jù)窗縮小以及傳輸路徑不一致，造成數(shù)據(jù)和時(shí)鐘信號(hào)在FPGA的接收端發(fā)生位偏移和字偏移。動(dòng)態(tài)相位調(diào)整技術(shù)根據(jù)當(dāng)前各數(shù)據(jù)線物理狀態(tài)，對(duì)各信號(hào)線動(dòng)態(tài)進(jìn)行去偏移操作，克服了靜態(tài)相位調(diào)整中參數(shù)不可再調(diào)的缺點(diǎn)，使接口不斷適應(yīng)外部環(huán)境的變化，從而保證數(shù)據(jù)的可靠傳輸。 | |
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