| 有功電能計(jì)量IP核的設(shè)計(jì) | |
| 所屬分類：技術(shù)論文 | |
| 上傳者：aet | |
| 文檔大小：226 K | |
| 標(biāo)簽： FPGA | |
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| 文檔介紹：對(duì)有功電能計(jì)量的數(shù)學(xué)模型進(jìn)行了分析，給出了相應(yīng)的IP核實(shí)現(xiàn)模型，并詳細(xì)討論了CIC抽取濾波器、IIR高通濾波器、 FIR低通濾波器、數(shù)字頻率變換等模塊的原理與設(shè)計(jì)。利用Simulink模型進(jìn)行了仿真，用VHDL作為設(shè)計(jì)語(yǔ)言，在QuartusII軟件下完成綜合和仿真，并在Altera公司的FPGA芯片CycloneII EP2C35F484C8目標(biāo)板上實(shí)現(xiàn)設(shè)計(jì)。 | |
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