《電子技術(shù)應(yīng)用》
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基于FPGA的微震信息采集系統(tǒng)研究
2015年電子技術(shù)應(yīng)用第11期
李良光,余芳芳,曹玲玲,趙舒暢
(安徽理工大學(xué) 電氣與信息工程學(xué)院,安徽 淮南232001)
摘要: 針對(duì)煤炭開(kāi)采過(guò)程中地質(zhì)災(zāi)害預(yù)防的技術(shù)障礙問(wèn)題,提出了一種基于FPGA的礦山微震監(jiān)測(cè)系統(tǒng)。系統(tǒng)以FPGA為核心處理器,對(duì)采集的微震信號(hào)進(jìn)行放大、濾波等一系列處理。其中,信號(hào)的放大系數(shù)可根據(jù)不同的采集環(huán)境進(jìn)行相應(yīng)的配置;系統(tǒng)還增加了乒乓緩存模塊和數(shù)字濾波模塊,加快了數(shù)據(jù)的處理速度,提高了數(shù)據(jù)的處理精度;微震信息數(shù)據(jù)通過(guò)以太網(wǎng)傳輸,減少了誤碼率,實(shí)現(xiàn)了遠(yuǎn)程監(jiān)測(cè)。最后,選擇系統(tǒng)的幾個(gè)采集通道進(jìn)行了現(xiàn)場(chǎng)的實(shí)驗(yàn)測(cè)試,實(shí)驗(yàn)結(jié)果驗(yàn)證了該方案的可行性。
中圖分類(lèi)號(hào): TD76
文獻(xiàn)標(biāo)識(shí)嗎: A
DOI:10.16157/j.issn.0258-7998.2015.11.020

中文引用格式: 李良光,余芳芳,曹玲玲,等. 基于FPGA的微震信息采集系統(tǒng)研究[J].電子技術(shù)應(yīng)用,2015,41(11):70-73.
英文引用格式: Li Liangguang,Yu Fangfang,Cao Lingling,et al. Research of microseism information acquisition system based on FPGA[J].Application of Electronic Technique,2015,41(11):70-73.
Research of microseism information acquisition system based on FPGA
Li Liangguang,Yu Fangfang,Cao Lingling,Zhao Shuchang
College of Electric and Information Engineering,Anhui University of Science and Technology,Huainan 232001,China
Abstract: According to the process of coal mining on geological disaster prevention technical barriers, a mine microseismic monitoring system based on FPGA is proposed in this paper. Microseismic signal acquisition system designed in this paper, taking FPGA as the core processor, amplification, filtering microseismic signal and so on. Among them, the signal amplification factor is configurable according to different environment. The system uses FPGA as the core processing module; system increases the ping-pong cache module and digital filter module, speed up the processing of the data and improves the accuracy of data processing. Microseismic signal through the Ethernet transmission, reduce the bit error rate, and realizes remote monitoring. Finally, several acquisition channels of the system are chosen for experiment, and the experimental results show the feasibility of the scheme.
Key words : microseismic;signal acquisition;digit filter;Ethernet transmission

 

0 引言

  隨著社會(huì)經(jīng)濟(jì)和科學(xué)技術(shù)的發(fā)展,礦山開(kāi)采技術(shù)越來(lái)越成熟,但地質(zhì)的微震活動(dòng)會(huì)引發(fā)很多災(zāi)難[1]。目前,人們通過(guò)對(duì)微震數(shù)據(jù)的分析能夠預(yù)測(cè)微震發(fā)生的時(shí)間和位置,對(duì)礦山井下很多由于沖擊壓力危害帶來(lái)的災(zāi)難問(wèn)題得到一定程度的預(yù)防和治理,但在利用微震監(jiān)測(cè)技術(shù)以及相關(guān)設(shè)備的性能方面還存在很多的缺陷[2]。針對(duì)這一情況,設(shè)計(jì)了一種基于FPGA的煤礦井下微震信息采集和傳輸系統(tǒng)。

1 微震信息采集系統(tǒng)總體設(shè)計(jì)


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  微震信號(hào)采集系統(tǒng)硬件框圖如圖1所示,主要由電源電路、前端調(diào)理電路、A/D轉(zhuǎn)換電路、FPGA及ARM系統(tǒng)及其接口電路、TF卡存儲(chǔ)電路、以太網(wǎng)控制器這幾大部分組成。考慮到微震波特點(diǎn),其采集的信號(hào)頻率范圍在20 Hz~500 Hz之間[3],系統(tǒng)采用12路信息采集,選擇特殊的地震傳感器采集微震信號(hào);采集的微震信號(hào)經(jīng)過(guò)調(diào)理電路進(jìn)行初步放大和模擬濾波處理,送往A/D轉(zhuǎn)換器;轉(zhuǎn)換后的數(shù)字信號(hào)送往FPGA,在FPGA中設(shè)計(jì)有高速緩存電路和數(shù)字濾波器,對(duì)信號(hào)進(jìn)行緩存和數(shù)字濾波處理,處理后的數(shù)據(jù)經(jīng)ARM通過(guò)以太網(wǎng)送往上位機(jī)。當(dāng)與上位機(jī)連接中斷時(shí),信息可臨時(shí)存儲(chǔ)在TF卡中[4]。

2 硬件設(shè)計(jì)

  2.1 前端調(diào)理電路


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  由于采集的微震信號(hào)中包含大量的干擾信號(hào),因此信號(hào)經(jīng)過(guò)放大后還需要進(jìn)行初步濾波[4-5]。圖2為前端調(diào)理電路,設(shè)計(jì)了一個(gè)正反饋雙T形50 Hz窄帶陷波器[6],濾波后的信號(hào)送入OPA4350運(yùn)算放大器,最后進(jìn)入A/D轉(zhuǎn)換電路。

  2.2 A/D轉(zhuǎn)換電路


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  當(dāng)差分信號(hào)輸入到ADS1251中,首先進(jìn)入4階∑-▽調(diào)制器進(jìn)行調(diào)制,該調(diào)制器的調(diào)制時(shí)鐘來(lái)自系統(tǒng)時(shí)鐘分頻。調(diào)制好的信號(hào)進(jìn)入ADS1251的內(nèi)部數(shù)字濾波器,濾波器對(duì)信號(hào)進(jìn)行加權(quán)、計(jì)算得出平均值。最后數(shù)據(jù)通過(guò)ADS1251的串行接口輸出,方便與后端處理器連接[7]。ADS1251的電路接口如圖3所示,由于ADS1251引腳電平為+5 V,與其連接的FPGA的引腳電平為+3.3 V,在兩個(gè)芯片之間需要增加電平轉(zhuǎn)移芯片,完成兩個(gè)芯片不同電平的匹配。ADS1251的CLK引腳和SCLK引腳使用74HCT244作為緩沖器,信號(hào)輸出引腳則使用74LCX244作為緩沖器。

  ADS1251是24位的低功耗模數(shù)轉(zhuǎn)換器,輸出的最高位是符號(hào)位,其余23位為有效位。當(dāng)外部采樣時(shí)鐘頻率為8 MHz時(shí),采樣率fs=fclk/384=20.833 kHz,其中384個(gè)時(shí)鐘為一個(gè)周期。ADS1251工作模式有兩種,當(dāng)DOUT/DRDY引腳輸出高電平時(shí)為同步模式,反之為掉電模式。為了保證12路采集信號(hào)實(shí)時(shí)同步到達(dá)服務(wù)器,本系統(tǒng)的ADS1251采用同步模式,并且每60 s向12路ADS1251發(fā)送一次同步信號(hào)。

  ADS1251的數(shù)據(jù)轉(zhuǎn)換和同步由DOUT/DRDY引腳控制。當(dāng)DOUT/DRDY輸出高電平時(shí),表示ADS1251處于轉(zhuǎn)換狀態(tài),當(dāng)電平由高轉(zhuǎn)低時(shí),轉(zhuǎn)換結(jié)束,數(shù)據(jù)被存入輸出寄存器中。然后DOUT/DRDY會(huì)連續(xù)輸出6個(gè)低電平和6個(gè)高電平,表示數(shù)據(jù)準(zhǔn)備就緒,進(jìn)入輸出狀態(tài)。數(shù)據(jù)從高位到低位經(jīng)過(guò)24個(gè)SCLK周期后全部從寄存器中移出,DOUT/DRDY恢復(fù)低電平,等待下次轉(zhuǎn)換到來(lái)。因此,在新的轉(zhuǎn)換過(guò)程開(kāi)始前,必須將所有數(shù)據(jù)位讀完,圖4(a)為ADS1251時(shí)序圖。

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  數(shù)據(jù)轉(zhuǎn)換的384個(gè)時(shí)鐘周期中,前36個(gè)為DRDY狀態(tài),后348個(gè)時(shí)鐘為DATA狀態(tài),這樣就可以保證24位數(shù)據(jù)讀取完畢后才進(jìn)入下次轉(zhuǎn)換。如果SCLK不到24個(gè)時(shí)鐘周期,DOUT/DRDY引腳將保持未讀出的當(dāng)前數(shù)據(jù)直到下一個(gè)轉(zhuǎn)換周期。如果超過(guò)24個(gè)周期,則DOUT/DRDY引腳為低電平。

  綜上分析可知,F(xiàn)PGA對(duì)ADS的轉(zhuǎn)換控制中,保持與DOUT/DRDY信號(hào)同步非常重要,如果在最低數(shù)據(jù)位LSB還沒(méi)讀出前,DOUT/DRDY引腳就進(jìn)入DRDY狀態(tài),會(huì)導(dǎo)致LSB讀取失敗。

  根據(jù)上述流程,通過(guò)Verilog編程,在QUARTUSII的嵌入式邏輯分析儀SIGNALTAPII上進(jìn)行了仿真,仿真結(jié)果如圖4(b)所示。由仿真結(jié)果可以看出,在數(shù)據(jù)讀取狀態(tài),12路通道能夠同時(shí)讀取信息。

  2.3 FPGA中數(shù)據(jù)緩存及傳輸實(shí)現(xiàn)與仿真

  乒乓操作是一種數(shù)據(jù)流的處理技巧,在處理大數(shù)據(jù)量的緩存和傳輸時(shí),避免使用單個(gè)FIFO,讀寫(xiě)操作不能同時(shí)進(jìn)行,效率低下,因此常采用兩個(gè)FIFO的乒乓緩存機(jī)制來(lái)實(shí)現(xiàn)數(shù)據(jù)的無(wú)縫傳輸[8]。乒乓緩存的原理為:當(dāng)系統(tǒng)對(duì)兩個(gè)緩存模塊的其中一個(gè)進(jìn)行寫(xiě)數(shù)據(jù)時(shí),另一個(gè)緩存模塊則讀數(shù)據(jù),當(dāng)兩個(gè)模塊分別讀空和寫(xiě)滿(mǎn)時(shí),兩者通過(guò)節(jié)拍配合,互換讀寫(xiě)操作。使用這種方法,寫(xiě)入和讀出數(shù)據(jù)操作可以沒(méi)有任何停頓,因此可以完成數(shù)據(jù)的無(wú)縫緩存和傳輸[9]。

  乒乓操作流程為:將采集到的數(shù)據(jù)首先寫(xiě)入FIFO A,這時(shí)是沒(méi)有輸出的;當(dāng)FIFO A寫(xiě)滿(mǎn)后,輸入控制模塊會(huì)自動(dòng)切換到FIFO B,將數(shù)據(jù)寫(xiě)入FIFO B中,同時(shí)輸出控制模塊對(duì)FIFO A進(jìn)行讀操作;當(dāng)FIFO B寫(xiě)滿(mǎn)時(shí),輸入控制模塊會(huì)再次切換到FIFO A,進(jìn)行寫(xiě)操作,同時(shí)輸出切換到FIFO B。

  基于乒乓緩存機(jī)制的優(yōu)點(diǎn),考慮采集的數(shù)據(jù)量很大,本文在FPGA中設(shè)計(jì)了兩個(gè)異步FIFO單元,對(duì)數(shù)據(jù)進(jìn)行緩存和無(wú)縫傳輸。由于緩存單元前端是ADS轉(zhuǎn)換控制單元,對(duì)A/D采樣需要每分鐘進(jìn)行一次同步,在同步期間,是沒(méi)有數(shù)據(jù)寫(xiě)入緩存單元的,但是這并不影響數(shù)據(jù)的讀操作。乒乓緩存單元的整體思想是:不滿(mǎn)不讀,滿(mǎn)了讀完,讀空暫停。

  為了保證兩個(gè)FIFO正常切換,需要設(shè)計(jì)專(zhuān)門(mén)的讀、寫(xiě)控制模塊,簡(jiǎn)化復(fù)雜的時(shí)序命令,并且避免出錯(cuò)。其數(shù)據(jù)讀寫(xiě)狀態(tài)控制過(guò)程如圖5所示。

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  由于采用乒乓操作讀寫(xiě)數(shù)據(jù),對(duì)單個(gè)緩存的空間要求降低,因此兩個(gè)緩存模塊的存儲(chǔ)寬度和深度都選擇為32 B。在QUARTUSII上對(duì)乒乓操作進(jìn)行時(shí)序仿真,結(jié)果如圖6所示,F(xiàn)IFO A和FIFO B有“full”和“empty”兩種狀態(tài),且讀寫(xiě)操作總是交替進(jìn)行的。由于讀操作的頻率為20 MHz,寫(xiě)操作的頻率只有fw=(3.84 M/384)/24=0.417 kHz,可見(jiàn),數(shù)據(jù)讀出快于寫(xiě)入,在一個(gè)FIFO數(shù)據(jù)被讀空后,有較長(zhǎng)的暫停時(shí)間,方便后面的濾波器對(duì)數(shù)據(jù)進(jìn)行處理。

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  2.4 數(shù)字濾波器的設(shè)計(jì)與仿真


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  本文在FPGA中設(shè)計(jì)了一個(gè)32階的抽樣頻率為200 kHz、截止頻率為1 kHz的FIR低通濾波器[10]。在MATLAB中對(duì)濾波器進(jìn)行仿真,得到的幅頻響應(yīng)如圖7(a)所示,濾波器的輸入中含有大量噪聲,輸出信號(hào)噪聲明顯減小,如圖7(b)所示。從濾波前后的波形對(duì)比可以看出,F(xiàn)PGA中實(shí)現(xiàn)的濾波器,能消除大量的高頻噪聲,但是有一定的時(shí)間延遲,需要修正。

3 實(shí)驗(yàn)測(cè)試與結(jié)果分析

  為了測(cè)試系統(tǒng)采集微震信息是否準(zhǔn)確有效,通過(guò)對(duì)傳感器不同的布放,進(jìn)行了模擬現(xiàn)場(chǎng)實(shí)驗(yàn)。在12路通道中選擇7、8、9、10、12這5個(gè)傳感器作為實(shí)驗(yàn)通道,各通道對(duì)應(yīng)的傳感器分布位置如圖8(a)所示。除12路傳感器外,其余4個(gè)傳感器分布點(diǎn)組成了一個(gè)正方形,12路傳感器位置在該正方形的中心點(diǎn),傳感器的放置深度均為地下2 m。同時(shí),設(shè)置前端調(diào)理電路的增益值為64。

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  圖8(a)中A點(diǎn)坐標(biāo)處為人工震源點(diǎn),實(shí)驗(yàn)前,記錄各路傳感器及震源坐標(biāo),在確定系統(tǒng)正常后,在A點(diǎn)進(jìn)行敲擊,各傳感器將檢測(cè)到的數(shù)據(jù)傳至上位機(jī)。

  在上位機(jī)觀察到的采集信息如圖8(b)所示,其中距離震源非常近的12路傳感器最先采集到微震信息,且強(qiáng)度最高;另外幾路傳感器也監(jiān)測(cè)到了微震信息,其中7路和9路相對(duì)于8路和10路,距震源較近,所以先檢測(cè)到微震波形,且幅度也較高。

  震源定位的算法有很多種,在本次實(shí)驗(yàn)中,上位機(jī)采用的是Geiger定位方法,其主要思想是將第一監(jiān)測(cè)到微震信號(hào)的傳感器位置坐標(biāo)作為迭代初值,將多路監(jiān)測(cè)數(shù)據(jù)依次代入運(yùn)算,最后得到較準(zhǔn)確的震源位置。實(shí)驗(yàn)得到震源定位結(jié)果如表1所示。

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  由于實(shí)驗(yàn)條件和場(chǎng)地限制,傳感器都布置在同一平面內(nèi),對(duì)震源深度定位帶來(lái)較大誤差。要想得到更加精確的定位監(jiān)測(cè)結(jié)果,還需要完善上述實(shí)驗(yàn),如擴(kuò)大監(jiān)測(cè)范圍,增加傳感器數(shù)量及采用立體布點(diǎn)等措施。

4 結(jié)語(yǔ)

  微震波在預(yù)測(cè)地質(zhì)運(yùn)動(dòng)趨勢(shì)中有非常重要的作用,通過(guò)對(duì)微震信號(hào)的實(shí)時(shí)監(jiān)測(cè)和分析,可以判斷潛在威脅,有效規(guī)避煤礦采集作業(yè)過(guò)程中由于地質(zhì)微運(yùn)動(dòng)引起的礦難。本文針對(duì)微震信號(hào)的特點(diǎn),設(shè)計(jì)了一套基于FPGA的微震信號(hào)采集系統(tǒng),該系統(tǒng)采用非常靈敏的微震檢波器采集微震信號(hào),通過(guò)調(diào)理電路,對(duì)微震信號(hào)進(jìn)行初步濾波和放大處理,然后通過(guò)24位∑-▽型模數(shù)轉(zhuǎn)換器ADS1251對(duì)其進(jìn)行轉(zhuǎn)換,送入FPGA中進(jìn)行緩存、濾波處理,最后通過(guò)以太網(wǎng)送入上位機(jī)。系統(tǒng)不僅速度快、運(yùn)行穩(wěn)定,且功耗低、體積小,系統(tǒng)結(jié)構(gòu)簡(jiǎn)單,可推廣到我國(guó)的煤炭行業(yè),具有良好的應(yīng)用前景。

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