安捷倫" title="安捷倫">安捷倫科技（NYSE:A）宣布推出首款收發器" title="收發器">收發器模型庫。此模型庫是安捷倫與Altera公司（基于收發器的現場可編程門陣列（FPGA）的業界領先供應商）合作開發的成果，可與安捷倫先進設計系統軟件結合使用。與典型的模擬仿真方法相比，這款數千兆位" title="千兆位">千兆位收發器模型庫可降低數千兆速率印刷電路板和背板信號完整性" title="信號完整性">信號完整性設計和分析的開發成本并提高生產效率。 ?

安捷倫EEsof EDA部門產品銷售經理Joe Civello表示：“以前，信號完整性設計" title="完整性設計">完整性設計師在仿真數千兆位收發器性能時，只有一種非常費時的選擇：使用為低頻分析設計的仿真器超極限地工作。而現在使用新型Stratix II GX FPGA收發器模型庫，我們彼此的客戶就可以利用目前市場上最先進的仿真技術，進行更快、更精確的高速串行鏈路設計。” ?

Altera公司高端產品銷售高級總監David Greenfield表示：“客戶依賴我們的FPGA來構建高性能、低功率、具有出色信號完整性的綜合數千兆位收發器。我們與安捷倫合作開發了Stratix II GX模型庫，使設計師能夠使用安捷倫先進設計系統，結合經過挑選和測量的信道模型，精確快速地對收發器信號完整性進行模擬仿真。” ?

Stratix II GX模型庫將向Altera公司的預期客戶提供。如欲獲得模型庫，請與Altera公司銷售代表或分銷商聯系，或發送電子郵件至s2gx_models@altera.com。如欲了解Altera Stratix II GX FPGA的詳細信息，請訪問www.altera.com/stratix2gx。?

先進設計系統是業界領先的高頻、高速電子設計自動化軟件平臺。最近發布的軟件增加了新的信號完整性能力，例如添加了串行器/解串器（SERDES）/Verilog模擬混合信號協同仿真，可建立更完整的串行鏈路信號完整性設計流程。 ?

如欲了解安捷倫信號完整性設計解決方案的詳細信息，請訪問網址：www.agilent.com/find/signal-integrity。 ?

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Agilent EEsof EDA是業界領先的射頻混合信號電路和系統設計軟件提供商。該軟件與安捷倫公司測試與測量設備兼容，可用于設計測試與測量設備。有關Agilent EDA軟件產品的更多信息，請訪問www.agilent.com/find/eesof。?

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